周維龍,歐陽洪波,胡 姣,何小梅
(湖南工業(yè)大學(xué) 電氣與信息工程學(xué)院,湖南 株洲 412007)
大功率電器智能識(shí)別系統(tǒng)設(shè)計(jì)
周維龍,歐陽洪波,胡 姣,何小梅
(湖南工業(yè)大學(xué) 電氣與信息工程學(xué)院,湖南 株洲 412007)
針對各種各樣的大功率用電器走進(jìn)學(xué)生公寓所帶來的安全隱患,提出了一種基于FGPA的大功率電器智能識(shí)別系統(tǒng)的設(shè)計(jì)方案。該系統(tǒng)采用EP3C25E1448CN作為主控制器,外圍電路由保護(hù)模塊、數(shù)據(jù)檢測模塊、A/D轉(zhuǎn)換模塊、數(shù)據(jù)顯示模塊以及數(shù)據(jù)傳輸模塊組成;給出了控制系統(tǒng)模型,簡述了各功能模塊的作用,并采用自頂向下的設(shè)計(jì)思想,實(shí)現(xiàn)了大功率用電器智能識(shí)別器的設(shè)計(jì);詳細(xì)論述了系統(tǒng)硬件電路的設(shè)計(jì)以及A/D變換與乘法器的FPGA實(shí)現(xiàn)。測試結(jié)果表明:本系統(tǒng)存在一定誤差,但能滿足對大功率用電器的控制,系統(tǒng)是可行的。
大功率電器;功率采集;智能識(shí)別;FPGA
隨著人們生活水平的不斷提高,各類大功率電器(加濕器、烤火爐、空調(diào)、電磁爐、電熱淋浴器等)已悄然走進(jìn)千家萬戶,這導(dǎo)致了用電管理越來越難。學(xué)校公寓由于學(xué)生人數(shù)多,人口密度大,如果對學(xué)生用電管理不當(dāng),不僅會(huì)造成電能源的大量損耗,甚至引起火災(zāi),造成巨大的經(jīng)濟(jì)損失,以及人員傷亡[1]。
針對以上問題,目前一般做法是限時(shí)送電或在室內(nèi)安裝限流器,但是裝了限流器后,限制了大功率電器的使用,同時(shí)也影響了電腦等常規(guī)電器的使用,這樣達(dá)不到合理管理的目的。本文設(shè)計(jì)了一種基于FPGA(field programmable gate array)的大功率檢測器,通過檢測用電器的瞬時(shí)功率,判斷用電器是否為大功率用電器(禁用電器),并控制其電源的通斷,從而實(shí)現(xiàn)對公寓內(nèi)大功率用電器的有效管理。
1.1 系統(tǒng)總體方案
本系統(tǒng)將ALTERA公司生產(chǎn)的EP3C20作為主控制器模塊,外圍電路由保護(hù)模塊、數(shù)據(jù)檢測模塊、A/D轉(zhuǎn)換模塊(AD7701)、數(shù)據(jù)顯示模塊以及數(shù)據(jù)傳輸模塊(RS485)組成[2],如圖1所示。其中,主控制模塊完成數(shù)據(jù)處理、數(shù)據(jù)顯示和通信控制功能[3];保護(hù)模塊完成短路保護(hù)功能[4];數(shù)據(jù)檢測模塊完成對負(fù)載用電回路功率采集的功能;系統(tǒng)通過繼電器的通斷開控制回路的通斷,當(dāng)用電器功率大于設(shè)定值時(shí),繼電器斷開,切斷用電器的電源,該控制實(shí)現(xiàn)簡單,易于開發(fā)。
圖1 系統(tǒng)總體方框圖Fig.1 System block diagram
1.2 功率檢測電路設(shè)計(jì)與實(shí)現(xiàn)
用電器功率有視在功率S、有功功率P與無功功率Q之分,其中,有功功率指的是元件消耗的能量;無功功率指的是元件與能量的交換;視在功率反映了電路提供的最大能量。本系統(tǒng)主要是為了保護(hù)供電線路的安全,考慮的是傳輸線路的總負(fù)荷,因此,檢測用電器的視在功率。對視在功率的檢測最常用的方法主要有3種:
1)通過測量用電器兩端的電壓和通過用電器的電流,計(jì)算得S=UI;
2)通過測量用電器的電流和用電器的電阻,計(jì)算得S=I2R;
3)通過測量用電器兩端的電壓和用電器的電阻,計(jì)算得S=U2/R。
如要快速測出不同用電器的電阻,同時(shí)測得其電流或電壓值,在同一電路中是很難實(shí)現(xiàn)的,因此,本系統(tǒng)采用第一種方案。由霍爾電流傳感器測出被測對象的電流值,電壓傳感器測出電壓值,再由主控器FPGA將2個(gè)數(shù)值相乘,得到功率值。該測試實(shí)物如圖2所示。
圖2 功率檢測實(shí)物圖Fig.2 Physical picture of power testing
本文對數(shù)據(jù)的處理主要包括2方面:1)如何檢測用電器的功率;2)如何判斷公寓內(nèi)是否使用大功率用電器。
2.1 用電器功率檢測
在主控器FPGA中,可通過一個(gè)多位數(shù)字乘法器,將采集到的電壓和電流值相乘,即可得到用電器的功率。乘法器可采用各種不同的設(shè)計(jì)技巧,綜合后的電路亦有不同的執(zhí)行效能。常用的乘法器有移位乘法器、定點(diǎn)乘法器及布斯(Booth)乘法器。不帶符號(hào)的8位乘法器若采用連加方式,則最差情況需要28-1次加法才能完成計(jì)算;而移位乘法器則最多需要8次即可完成乘法計(jì)算。移位乘法器是通過逐項(xiàng)移位相加原理實(shí)現(xiàn),從被乘數(shù)的最低位開始,第n位若為1,則乘數(shù)左移n位,再與上一次的和相加;若為0,乘數(shù)左移n位后以全零相加,直至被乘數(shù)的最高位。因此,最多判斷8次即可獲得2個(gè)數(shù)的乘積[4]。
2.2 大功率用電器識(shí)別
對公寓大功率用電器的識(shí)別,可通過不停檢測每間宿舍的總功率,若在某時(shí)刻總功率突然增加(ΔP)較大,則表明該宿舍啟動(dòng)了大功率電器,從而切斷該宿舍電源。因此,本文采用乒乓控制法。宿舍可以使用的電器僅局限于普通充電器、電風(fēng)扇以及電腦等。臺(tái)式電腦的功率一般在350W左右,閾值的大小可設(shè)定在450W左右。通過一個(gè)16位數(shù)據(jù)比較器對采集的瞬時(shí)功率與設(shè)定值進(jìn)行比較,即可實(shí)現(xiàn)對大功率用電器的識(shí)別。該系統(tǒng)精度高達(dá)0.1%,對于大功率的比較,完全滿足實(shí)際要求。
隨著微電子技術(shù)不斷發(fā)展,F(xiàn)PGA技術(shù)取得了飛速發(fā)展。由于其具有集成度高,工作速度快和可現(xiàn)場編程等特點(diǎn),因此,在數(shù)字信號(hào)處理中得到了廣泛應(yīng)用[5]。在本系統(tǒng)中,F(xiàn)PGA控制器主要完成對A/ D轉(zhuǎn)換器控制、功率采集、大功率電器的識(shí)別、數(shù)據(jù)顯示以及數(shù)據(jù)傳輸?shù)裙δ躘5]。系統(tǒng)控制電路框圖如圖3所示。
圖3 系統(tǒng)控制電路框圖Fig.3 System control circuit diagram
1)A/D轉(zhuǎn)換控制模塊
該模塊的主要功能是完成模/數(shù)變換,將傳感器采集到的電壓與電流值轉(zhuǎn)換成數(shù)字量。系統(tǒng)采用美國Analog公司生產(chǎn)的AD7701作為A/D轉(zhuǎn)換芯片,因其具有功耗低、精度高、抗干擾能力強(qiáng)等特點(diǎn),被廣泛應(yīng)用于儀器儀表、參數(shù)檢測、數(shù)據(jù)采集等設(shè)備中。CS為片選端,低電平有效,可由FPGA對時(shí)鐘信號(hào)分頻得到;SCLK為串行時(shí)鐘端,由FPGA對時(shí)鐘信號(hào)進(jìn)行分頻與PWM(pulse width modulation)處理后得到;DRDY為數(shù)據(jù)準(zhǔn)備端,數(shù)據(jù)寄存器數(shù)據(jù)準(zhǔn)備好時(shí)為低電平,數(shù)據(jù)傳送完畢后為高電平,可作為數(shù)據(jù)是否傳輸完畢的控制信號(hào);CLKIN為主時(shí)鐘信號(hào)(4MHz)輸入端,可由FPGA對時(shí)鐘信號(hào)經(jīng)10分頻得到;SDADT為串行數(shù)據(jù)輸出端,將轉(zhuǎn)換后的數(shù)據(jù)以串行通信的方式輸出,當(dāng)FPGA給AD7701的CS端第一個(gè)下降沿時(shí),AD7701開始發(fā)送第一幀A/D轉(zhuǎn)換數(shù)據(jù)(高8位DB8~DB15),低位在前,當(dāng)給CS端第二個(gè)下降沿時(shí),AD7701輸出第二幀8位數(shù)據(jù)(低8位DB0~DB7)。
2)串/并轉(zhuǎn)換模塊
本模塊為一個(gè)8位串/并轉(zhuǎn)換器,將AD7701串行數(shù)據(jù)輸出端SDADT輸出的數(shù)據(jù),分2次轉(zhuǎn)換成16位并行數(shù)據(jù)輸入到乘法電路中。其中第一次為高8位數(shù)據(jù),第二次為低8位數(shù)據(jù)。
3)比較器控制模塊
比較器控制電路是實(shí)現(xiàn)乒乓控制法的關(guān)鍵部件。將乘法器輸出的數(shù)據(jù)與設(shè)定功率閾值進(jìn)行比較,當(dāng)用電器工作的瞬時(shí)功率小于或等于設(shè)定功率時(shí),輸出低電平;否則,輸出高電平,并通過系統(tǒng)執(zhí)行部件,切斷用電器工作電源,實(shí)現(xiàn)對大功率電器的智能控制。
4)乘法電路模塊
傳感器采集的電壓與電流,經(jīng)信號(hào)調(diào)理后輸入到乘法器中,通過乘法電路實(shí)現(xiàn)兩者相乘,從而得到用電器的功率。
5)LCD控制模塊
系統(tǒng)采用MCD12864作為顯示器模塊,主要顯示用電器的工作電壓、電流、功率及當(dāng)前的工作狀態(tài)。其中,E為使能信號(hào)控制端;R/W為讀/寫操作控制端,當(dāng)FPGA輸出高電平時(shí)進(jìn)行讀操作,輸出低電平時(shí)進(jìn)行寫操作;RS為寄存器選擇控制,高電平為數(shù)據(jù),低電平為指令;DB7-0為數(shù)據(jù)總線。
6)RS485控制模塊
RS485接口芯片已被廣泛應(yīng)用于工業(yè)控制、儀器、儀表、多媒體網(wǎng)絡(luò)、機(jī)電一體化產(chǎn)品等諸多領(lǐng)域[6-7]。系統(tǒng)采用MAX1483芯片作為數(shù)據(jù)傳輸模塊,將采集的功率傳輸?shù)缴衔粰C(jī),可實(shí)現(xiàn)對用電器的遠(yuǎn)程監(jiān)控。RO為接收器輸出控制端;RE為接收器輸出使能,低電平有效;DI為發(fā)送器輸入端;DE為發(fā)送器輸出使能控制端。
4.1 A/D轉(zhuǎn)換
由文獻(xiàn)[6]可知:fSCLK=5MHz,SCLK高電平脈沖寬度t11≥35ns,SCLK低電平脈沖寬度t12≥160ns,數(shù)據(jù)以fout=4kHz速率更新16位數(shù)據(jù)輸出寄存器的內(nèi)容。因此,SCLK時(shí)鐘信號(hào)可由EP3C時(shí)鐘(40MHz)經(jīng)8分頻,得到fSCLK=5MHz。為簡化脈寬調(diào)制器的設(shè)計(jì),取占空比為1∶3(即2∶6),此時(shí)t11=80ns,t12=160ns。采用VHDL(very-high-speed integrated circuit hardware description language)語言實(shí)現(xiàn)分頻器的設(shè)計(jì),F(xiàn)_SCLK時(shí)序仿真如圖4所示。從圖中可以看出,設(shè)計(jì)完全符合要求。
圖4F_SCLK 時(shí)序仿真圖Fig.4 Timing simulation diagram of F_SLCK
4.2 8位移位乘法器
根據(jù)乘法器原理與二進(jìn)制法原理分析可得,整個(gè)乘法器系統(tǒng)包括計(jì)數(shù)模塊、乘法移位模塊、被乘數(shù)輸入模塊、二進(jìn)制加法模塊和乘積寄存器模塊等構(gòu)成[8]。移位乘法器采用模塊化設(shè)計(jì),先用VDHL語言實(shí)現(xiàn)各模塊的邏輯功能,并生成相應(yīng)的元件,在頂層把功能模塊連接成如圖5所示電路,編譯后仿真,可得圖6所示波形。
圖5 8位移位乘法器電路原理圖Fig.5 The schematic of 8-bit multiplier
圖6是使用QuartusⅡ8.0對移位乘法器進(jìn)行時(shí)序仿真的結(jié)果。a, b, p均采用十六進(jìn)制,由圖可以看出,輸入a=05, b=05時(shí),乘積輸出p應(yīng)為5×5=25,實(shí)際仿真輸出為0019H即25,這說明仿真結(jié)果是正確的。
圖6 8位乘法器時(shí)序傳真結(jié)果Fig.6 Timing simulation diagram of 8-bit multiplier
4.3 頂層控制
運(yùn)用原理圖輸入的設(shè)計(jì)方法是,將各單元模塊所生成的元件在頂層按圖3的方式連接,即可構(gòu)成整個(gè)系統(tǒng)的硬件原理圖。該系統(tǒng)以Alter公司生產(chǎn)的EP3C25E1448CN為主控制器,整個(gè)系統(tǒng)主要包括初始狀態(tài)(initialization)、數(shù)據(jù)采集狀態(tài)(data_sample)、數(shù)據(jù)處理狀態(tài)(data_processing)、RS485傳輸狀態(tài)(RS485_ transfers)、數(shù)據(jù)顯示狀態(tài)(data_display)5種狀態(tài),因此,可以利用有限狀態(tài)機(jī)的設(shè)計(jì)方案來實(shí)現(xiàn)。其狀態(tài)轉(zhuǎn)換如圖7所示[9]。通過開發(fā)工具QuartusⅡ8.0對各個(gè)模塊的 VHDL 源程序及頂層電路進(jìn)行編譯、邏輯綜合,電路的糾錯(cuò)、驗(yàn)證、自動(dòng)布局布線及仿真等各種測試,最終將設(shè)計(jì)編譯的數(shù)據(jù)下載到芯片中即可。
圖7 系統(tǒng)狀態(tài)轉(zhuǎn)換圖Fig.7 System state transition diagram
在圖2的基礎(chǔ)上,外接MCD12864顯示模塊,得到本系統(tǒng)的整個(gè)硬件電路,再將不同的用電器接到圖中的插線板上進(jìn)行測試。表1為一組測試數(shù)據(jù)。
表1 測試結(jié)果Table1 Results of test W
由測試數(shù)據(jù)可看出,系統(tǒng)存在一定的誤差。引起誤差的主要原因有2個(gè)方面:1)用電器的標(biāo)稱值本身就是一個(gè)估計(jì)值,與其實(shí)際功率有一定偏差;2)電流傳感器的輸出電壓為
而實(shí)際工作電壓小于5V。盡管如此,對大功率用電器的識(shí)別,幾瓦的誤差對實(shí)際運(yùn)用不會(huì)造成大的影響,因此,本系統(tǒng)是切實(shí)可行的。
本方案可實(shí)現(xiàn)對用電器功率的即時(shí)采集,在下一步研究工作中,通過RS485遠(yuǎn)程通信,實(shí)現(xiàn)大功率用電器的遠(yuǎn)監(jiān)控,這對實(shí)現(xiàn)學(xué)生公寓安全用電、綠色照明具有較大的市場價(jià)值。
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(責(zé)任編輯:鄧 彬)
Design of Intelligent Cognitive System of High-Power Electrical Appliances
Zhou Weilong,Ouyang Hongbo,Hu Jiao,He Xiaomei
(School of Electrical and Information Engineering,Hunan University of Technology,Zhuzhou Hunan 412007,China)
In view of the hidden dangers of various high-power electrical appliances into student’s apartment, proposes a cognitive system of high-power electric appliances based on FPGA. The system uses EP3C25E1448CN as the microprocessor and the peripheral circuit consists of protection module, data detection module, A/D conversion module, data display module and data communication module. Provides the control system model and describes the role of each functional module, and with top-to-down design ideas, realizes the intelligent cognitive device design for high-power electrical appliances. Elaborates the system hardware circuit design and FPGA implementation of A/D conversion and multiplier. The test results indicate that the system exists some error but it is feasible and can meet the use of high-power electrical control.
high-power electrical appliance;power acquisition;intelligent cognitive;FPGA
TM769
:A
:1673-9833(2014)01-0044-05
2013-11-12
湖南省教育廳一般基金資助項(xiàng)目(13C024),湖南工業(yè)大學(xué)大學(xué)生研究性學(xué)習(xí)和創(chuàng)新性實(shí)驗(yàn)計(jì)劃基金資助項(xiàng)目(湖工大教字[2013]9號(hào)-47),湖南省科學(xué)技術(shù)廳科技計(jì)劃一般基金資助項(xiàng)目(2011FJ3128)
周維龍(1978-),男,湖南邵陽人,湖南工業(yè)大學(xué)教師,主要研究方向?yàn)榍度胂到y(tǒng)設(shè)計(jì)及應(yīng)用,無線傳感器網(wǎng)絡(luò)技術(shù),E-mail:weilong_12345@163.com
10.3969/j.issn.1673-9833.2014.01.009